初級(jí)程序員計(jì)算機(jī)系統(tǒng)基礎(chǔ)知識(shí)章節(jié)練習(xí)(2019.03.30)

單項(xiàng)選擇題
中央處理單元（CPU）不包括（）。
A.算術(shù)邏輯運(yùn)算單元
B.控制器
C.通用寄存器組
D.I/O總線
單項(xiàng)選擇題
用（）時(shí)，校驗(yàn)位與信息位交叉設(shè)置。
A.循環(huán)冗余校驗(yàn)碼
B.海明校驗(yàn)碼
C.奇校驗(yàn)碼
D.偶校驗(yàn)碼
單項(xiàng)選擇題
使用電容存儲(chǔ)信息且需要周期性地進(jìn)行刷新的存儲(chǔ)器是（）。
A.DRAM
B.EPROM
C.SRAM
D.EEPROM
單項(xiàng)選擇題
空白（1）處應(yīng)選擇（）
A.81
B.87
C.OF
D.FF
單項(xiàng)選擇題
計(jì)算機(jī)中，執(zhí)行一條指令所需要的時(shí)間稱(chēng)為指令周期，完成一項(xiàng)基本操作所需要的時(shí)間稱(chēng)為機(jī)器周期，時(shí)鐘脈沖的重復(fù)周期稱(chēng)為時(shí)鐘周期。因此（）。
A.時(shí)鐘周期大于機(jī)器周期
B.時(shí)鐘周期等于機(jī)器周期
C.機(jī)器周期大于指令周期
D.指令周期大于時(shí)鐘周期
單項(xiàng)選擇題
某邏輯電路有兩個(gè)輸入端和一個(gè)輸出端，輸入端用X和Y表示，輸出端用Z表示。當(dāng)且僅當(dāng)X和y同時(shí)為1時(shí)，Z才為0，則該電路的邏輯表達(dá)式為（）。
A.X·Y
B.
C.
D.X+Y
單項(xiàng)選擇題
將某ASCII字符采用偶校驗(yàn)編碼（7位字符編碼+1位校驗(yàn)碼）發(fā)送給接收方，接收方收到的8位數(shù)據(jù)中，若（），則能確定傳輸過(guò)程中發(fā)生錯(cuò)誤。
A."1"的個(gè)數(shù)為奇數(shù)
B."1"的個(gè)數(shù)為偶數(shù)
C.最低位為"1"
D.最高位為"1"
單項(xiàng)選擇題
空白（2）處應(yīng)選擇（）
A.F9
B.F0
C.89
D.80
單項(xiàng)選擇題
32位微處理器的32是指（）。
A.系統(tǒng)總線的寬度為32位
B.處理的數(shù)據(jù)長(zhǎng)度只能為32位
C.CPU字長(zhǎng)為32位
D.通用寄存器數(shù)目為32個(gè)
單項(xiàng)選擇題
以下關(guān)于精簡(jiǎn)指令集計(jì)算機(jī)（RISC）指令系統(tǒng)特點(diǎn)的敘述中，錯(cuò)誤的是（）。
A.對(duì)存儲(chǔ)器操作進(jìn)行限制，使控制簡(jiǎn)單化
B.指令種類(lèi)多，指令功能強(qiáng)
C.設(shè)置大量通用寄存器
D.選取使用頻率較高的一些指令，提高執(zhí)行速度

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初級(jí)程序員計(jì)算機(jī)系統(tǒng)基礎(chǔ)知識(shí)章節(jié)練習(xí)(2019.03.30)

中央處理單元（CPU）不包括（）。

用（）時(shí)，校驗(yàn)位與信息位交叉設(shè)置。

使用電容存儲(chǔ)信息且需要周期性地進(jìn)行刷新的存儲(chǔ)器是（）。

空白（1）處應(yīng)選擇（）

計(jì)算機(jī)中，執(zhí)行一條指令所需要的時(shí)間稱(chēng)為指令周期，完成一項(xiàng)基本操作所需要的時(shí)間稱(chēng)為機(jī)器周期，時(shí)鐘脈沖的重復(fù)周期稱(chēng)為時(shí)鐘周期。因此（）。

某邏輯電路有兩個(gè)輸入端和一個(gè)輸出端，輸入端用X和Y表示，輸出端用Z表示。當(dāng)且僅當(dāng)X和y同時(shí)為1時(shí)，Z才為0，則該電路的邏輯表達(dá)式為（）。

將某ASCII字符采用偶校驗(yàn)編碼（7位字符編碼+1位校驗(yàn)碼）發(fā)送給接收方，接收方收到的8位數(shù)據(jù)中，若（），則能確定傳輸過(guò)程中發(fā)生錯(cuò)誤。

空白（2）處應(yīng)選擇（）

32位微處理器的32是指（）。

以下關(guān)于精簡(jiǎn)指令集計(jì)算機(jī)（RISC）指令系統(tǒng)特點(diǎn)的敘述中，錯(cuò)誤的是（）。

初級(jí)程序員計(jì)算機(jī)系統(tǒng)基礎(chǔ)知識(shí)章節(jié)練習(xí)(2019.03.30)

中央處理單元（CPU）不包括（）。

用（）時(shí)，校驗(yàn)位與信息位交叉設(shè)置。

使用電容存儲(chǔ)信息且需要周期性地進(jìn)行刷新的存儲(chǔ)器是（）。

空白（1）處應(yīng)選擇（）

計(jì)算機(jī)中，執(zhí)行一條指令所需要的時(shí)間稱(chēng)為指令周期，完成一項(xiàng)基本操作所需要的時(shí)間稱(chēng)為機(jī)器周期，時(shí)鐘脈沖的重復(fù)周期稱(chēng)為時(shí)鐘周期。因此（）。

某邏輯電路有兩個(gè)輸入端和一個(gè)輸出端，輸入端用X和Y表示，輸出端用Z表示。當(dāng)且僅當(dāng)X和y同時(shí)為1時(shí)，Z才為0，則該電路的邏輯表達(dá)式為（）。

將某ASCII字符采用偶校驗(yàn)編碼（7位字符編碼+1位校驗(yàn)碼）發(fā)送給接收方，接收方收到的8位數(shù)據(jù)中，若（），則能確定傳輸過(guò)程中發(fā)生錯(cuò)誤。

空白（2）處應(yīng)選擇（）

32位微處理器的32是指（）。

以下關(guān)于精簡(jiǎn)指令集計(jì)算機(jī)（RISC）指令系統(tǒng)特點(diǎn)的敘述中，錯(cuò)誤的是（）。

中央處理單元（CPU）不包括（）。

用（）時(shí)，校驗(yàn)位與信息位交叉設(shè)置。

使用電容存儲(chǔ)信息且需要周期性地進(jìn)行刷新的存儲(chǔ)器是（）。

計(jì)算機(jī)中，執(zhí)行一條指令所需要的時(shí)間稱(chēng)為指令周期，完成一項(xiàng)基本操作所需要的時(shí)間稱(chēng)為機(jī)器周期，時(shí)鐘脈沖的重復(fù)周期稱(chēng)為時(shí)鐘周期。因此（）。

某邏輯電路有兩個(gè)輸入端和一個(gè)輸出端，輸入端用X和Y表示，輸出端用Z表示。當(dāng)且僅當(dāng)X和y同時(shí)為1時(shí)，Z才為0，則該電路的邏輯表達(dá)式為（）。

將某ASCII字符采用偶校驗(yàn)編碼（7位字符編碼+1位校驗(yàn)碼）發(fā)送給接收方，接收方收到的8位數(shù)據(jù)中，若（），則能確定傳輸過(guò)程中發(fā)生錯(cuò)誤。

以下關(guān)于精簡(jiǎn)指令集計(jì)算機(jī)（RISC）指令系統(tǒng)特點(diǎn)的敘述中，錯(cuò)誤的是（）。